summaryrefslogtreecommitdiffstats
path: root/sw/cpld/address_decoder.jed
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authorNao Pross <naopross@thearcway.org>2017-11-23 14:34:55 +0100
committerNao Pross <naopross@thearcway.org>2017-11-23 14:34:55 +0100
commit141137dfe5bdc7400d5cc1ad388b670f9f2e9446 (patch)
treebef58de3c44787dadb22ec9cf452a3606ddd6708 /sw/cpld/address_decoder.jed
parentImprovements in PIO driver, pio test rewritten in inline asm (diff)
downloadz80uPC-141137dfe5bdc7400d5cc1ad388b670f9f2e9446.tar.gz
z80uPC-141137dfe5bdc7400d5cc1ad388b670f9f2e9446.zip
update cpld files from VHDL dev machine and delete programmer code (unused)
Diffstat (limited to '')
-rwxr-xr-xsw/cpld/address_decoder.jed288
1 files changed, 288 insertions, 0 deletions
diff --git a/sw/cpld/address_decoder.jed b/sw/cpld/address_decoder.jed
new file mode 100755
index 0000000..dcf247b
--- /dev/null
+++ b/sw/cpld/address_decoder.jed
@@ -0,0 +1,288 @@
+|--------------------------------------------|
+|- ispDesignExpert Fitter Report File -|
+|- Version 8.3.02.12_DE_HDL_BASE -|
+|- (c)Copyright, Lattice Semiconductor 1999 -|
+|--------------------------------------------|
+
+
+TITLE:
+AUTHOR:
+PATTERN:
+COMPANY:
+REVISION:
+DATE: Thu Nov 23 11:55:45 2017
+
+ABEL mach432
+ *
+QP44*
+QF16160*
+G0*F0*
+NOTE Part Number : M4-32/32-15JC *
+NOTE Handling of Preplacements No Change *
+NOTE Use placement data from address_decoder.vct *
+NOTE Global clocks routable as PT clocks? N *
+NOTE 22V10/MACH1XX/2XX S/R Compatibility? Y *
+NOTE SET/RESET treated as DONT_CARE? N *
+NOTE Reduce Unforced Global Clocks? N *
+NOTE Iterate between partitioning and place/route? Y *
+NOTE Balanced partitioning? Y *
+NOTE Reduce Routes Per Placement? N *
+NOTE Spread Placement? Y *
+NOTE Run Time Upper Bound in 15 minutes 0 *
+NOTE Table of pin names and numbers*
+NOTE PINS MMU_IN_7_:2 MMU_IN_6_:3 MMU_IN_15_:21 MMU_IN_5_:4*
+NOTE PINS MMU_IN_4_:5 MMU_OUT_15_:36:66 MMU_IN_3_:6 IORQ:30*
+NOTE PINS MMU_IN_2_:7 CSROML:24:75 CSROMH:25:71 MMU_OUT_14_:37:62*
+NOTE PINS CSRAM:26:74 MMU_OUT_13_:38:65 CSUART:27:70 MMU_OUT_12_:39:61*
+NOTE PINS CSCTC:28:73 CSPIO:29:69 MMU_IN_14_:20 MMU_IN_13_:19*
+NOTE PINS MMU_IN_12_:18 *
+NOTE Table of node names and numbers*
+NOTE Interleaved Central Switch Matrices for BLOCKS 0 and 1 *
+L000000
+ 101111111111101110111111111111101111111111111111111111111111111111 11101110101011
+ 111011111111111011101011101111111111111111111111111111111111111111 11111111111111
+ 111111111111111111111111111111111111101111111111111111111111111111 11111111111111
+ 111111111111111111111111111011111111111111111111111111111111111111 11111111111111
+ 111111111111111111111111111111111111111111111111111111111111111111 11111111111111
+ 111111111111111111111111111111111111111111111111111111111111111111 11101110101011*
+NOTE Non-CSM fuses for BLOCK 0 *
+L000480
+ 000000000000000000000000000000000000000000000000000000000000000000 11111111111111*
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